Projeto de um amplificador de ganho programável para aplicações de comunicação por campo de proximidade (NFC).

Detalhes bibliográficos
Ano de defesa: 2019
Autor(a) principal: Martins, Tarciso Alvim
Orientador(a): Não Informado pela instituição
Banca de defesa: Não Informado pela instituição
Tipo de documento: Dissertação
Tipo de acesso: Acesso aberto
Idioma: por
Instituição de defesa: Biblioteca Digitais de Teses e Dissertações da USP
Programa de Pós-Graduação: Não Informado pela instituição
Departamento: Não Informado pela instituição
País: Não Informado pela instituição
Palavras-chave em Português:
Amplificadores
Circuitos integrados
Comunicação NFC
Integrated circuits
Microeletrônica
NFC
Programmable gain amplifier
Link de acesso: https://www.teses.usp.br/teses/disponiveis/3/3140/tde-02082023-092707/
Resumo: Nesta dissertação é apresentado o projeto de um amplificador de ganho programável para aplicações NFC (Near Field Communication), ou mais especificamente, em demodulação de carga a partir de detectores de envelope. Esse circuito possui o intuito de ser utilizado em um circuito integrado leitor de NFC comercial. Temas como metodologia e fluxo de projetos de circuitos integrados são apresentados e seguidos ao longo da evolução do trabalho. Os passos do desenvolvimento do projeto de um bloco para um circuito integrado de aplicação específica são detalhados e seguidos, passando desde sua concepção, estudo da literatura, escolha da arquitetura, dimensionamento de dispositivos, desenvolvimento do layout, simulações com parasitas extraídos, até finalmente a fabricação e os testes do circuito integrado. As principais características do amplificador de ganho programável desenvolvido são possuir dois estágios de ganho com até oito configurações diferentes, ajuste individual da compensação por ganho, visando a otimização da faixa de operação, e a presença de um sistema de auto-zero capaz de cancelar o offset do amplificador. O circuito foi desenvolvido na tecnologia TSMC 90 nm, fabricado em três versões, seguindo a curva de evolução do projeto. Ao final, o bloco projetado apresentou um comportamento adequado para sua aplicação, atingindo suas especificações. O amplificador apresenta baixo consumo de potência, apenas 324 W em cada estágio, frequência de corte maior que 4 MHz para todos os ganhos, bom PSRR, superior a -38 dB e uma área de apenas 0,0285 mm².
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